Часы на ИВ-21 на ПЛИС. Пояснения к Verilog. Altera EPM240 FPGA
HTML-код
- Опубликовано: 14 июл 2024
- Присоединяйтесь подпиской в instagram: avrorel
Материалы: disk.yandex.ru/d/vac9Xl2zmYzGfg
Помощь каналу: yoomoney.ru/to/410013914943537
0:00 - Часы на ИВ-21
1:41 - Схемотехника
4:41 - Verilog - Наука
Классный контент. Просмотров мало как обычно. Спасибо за пояснения!
Сколько ячеек памяти занимает конфигурация? Я просчитывал, в теории можно на этом чипе добавить будильник с генератором прерывистого сигнала. Должно вместится. Кстати, ChatGPT хорошо помогает с кодом, потому что тут чистая логика.
Логических элементов ровно половину заняло (120). Я тоже прикидывал что на будильник хватит
А можно схему с прошивкой для повторения?
Проект Альтиума disk.yandex.ru/d/hQz5xEaoMK2reQ
А проект Квартуса в описании ссылка